源代码输入完成后，我们将器件选择为EPM7128SLC84-15。引脚分配需要参考MCU&CPLD DEMO试验板的电路原理，这里的引脚分配见表80器件编译通过后，可进行仿真，仿真终止时间( EndTime)设为100 u S，T信号半周期设为5 u S，复位信号( CLR)前10 u S为高电平，之后为低电平。下图为带有复位的异步T触发器在Quartus lI集成开发软件中的仿真波形。接下来进行*．pof至*.jed的文件转换，最后将*．jed文件下载到ATF1508AS芯片中。
在MCU＆CPLD DEMO试验板上，我们看到LEDO亮、LED1灭，这是由于GCLR键没有按下时为高电平，电路处于复位状态。按下GCLR键一直不放，然后每按动一下KO键。可以看到，LEDO、LED1的输出状态会发生翻转，符合带有复位的异步T触发器真值表（下表）。
5．带有复位的同步T触发器
1).带有复位的同步T触发器简介
上图为带有复位的同步T触发器电路框图，与带有复位的异步T触发器相比，增加了一个时钟端CLKo时钟CLK为输入门控信号，只有CLK信号到来时，输入信号T才能进入触发器。依CLK信号的触发方式不同，带有复位的同步T触发器可分为升沿触发和下降沿触发两种。上图为上升沿触发的带有复位的同步T触发器。
2).带有复位的同步T触发器的设计
在D盘中先建立一个文件名为CLR_SYT_FF的文件夹，然后建立一个CLR_SYT_FF的新项目，输入以下的源代码并保存为CLR_SYT_FF．v。
源代码输入完成后，我们将器件选择为EPM7128SLC84-15。引脚分配需要参考MCU＆CPLD DEMO试验板的电路原理，这里的引脚分配见上表。器件编译通过后，可进行仿真，仿真终止时间( EndTime)设为100 μS，T信号半周期设为5 μS，时钟信号(CLK)半周期设为3 μ S，复位信号( CLR)前10 μ S为高电平，之后为低电平。下图为带有复位的同步T触发器在Quartus lI集成开发软件中的仿真波形。接下来进行*．pof至*.jed的文件转换，最后将*.jed文件下载到ATF1508AS芯片中。
在MCU&CPLD DEMO试验板上，我们看到LEDO亮、LED1灭，这是由于GCLR键没有按下时为高电平，电路处于复位状态。按下GCLR键一直不放，改变SO的输入状态（开关拨上时为低电平，拨下时为高电平），然后再按动一下GCLK2键。可以看到，LEDO、LED1的输出状态符合带有复位的同步T触发器真值表。
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