5 FPGA验证及问题讨论
(1)FPGA验证时的7路2M数据间的延迟差
为了验证7路数据在传输中有不同延时，分接复用器依然能正常工作，就需要模拟出7路不同的延时来。有三种不同的实现方法来完成：·这7路不同的延时可以在FPGA内中用不同的非门串起来实现;
·可以采用74系列器件在FPGA外部完成不同延时的模拟;
·在FPGA内部用不同级数的D触发器来模拟7路不同的延时。
在本设计中采用的是第三种。该方法的好处是易于控制不同路的延时，只要改变不同路中D触发器的级数就可以改变7路不同的延时。
(2)为提高分接复用器的传输效率，可采用不固定插“0”法，例如HDLC中的插“0”法
(3)可以通过在综合时进一步加约束来提高分接复用器的工作频率。
本文中的分接复用器为系统通信提供了灵活的速率选择。可根据不同需要，以2Mbps为基数来配置各种数据速率。本设计中采用VHDL输入法及状态图输入法，大大缩短了设计周期，提高了设计的可靠性，并且大大增加了设计的可移值性。该设计的成功表明硬件描述高级语言(VHDL)是硬件设计的一种十分有效的手段。
本文关键字：复用器 嵌入式系统-技术，单片机-工控设备 - 嵌入式系统-技术
