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CPLD/FPGA在设计中的问题和可靠性有关的几个概念

CPLD/FPGA在设计中的问题和可靠性有关的几个概念

点击数：7551 次录入时间：03-04 11:50:32 整理：http://www.55dianzi.com DSP/FPGA技术

建立时间和保持时间

　

wpe3.jpg (5176 字节)

图1

　

竞争和冒险

　

PLD内部毛刺产生的原因

我们在使用分立元件设计数字系统时，由于PCB走线时，存在分布电感和电容，所以几纳秒的毛刺将被自然滤除，而在PLD内部决无分布电感和电容，所以在PLD/FPGA设计中，竞争和冒险问题将变的较为突出。

本文关键字：可靠性 DSP/FPGA技术，单片机-工控设备 - DSP/FPGA技术

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