图6所示是Modelsim的仿真波形。SCLK上跳沿DIN_out的数据被MAX1032读取。
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程序的第二部分的作用是将MAX1032输出的串行采样结果存入CPLD内部的一个14位寄存器。采样结果DOUT_in_S是14位的串行序列。CPLD在SCLK的上跳沿读取数据后，可将其存到一个内部寄存器，再由DOUT选择输出寄存器的高或低八位数据读出。最后的采样结果是并行输出的。总共2个字节，末两位数据无效。对于外部时钟模式，可从加载转换启动字开始计算，在第16个SCLK下跳沿，芯片将输入采样结果。得到结果即可按照公式(采样电压=12x(转换成十进制的输出结果)／16384)进行计算。以下是这部分功能的可综合代码：
图7所示是 Moddsim仿真 的CPLD读取MAX1032的采样结果并将其存入寄存器DOUT_P_buf的仿真图。由图可见，在启动采样后的第16个SCLK的下跳沿，MAX1032输出14位串行采样结果，CPLD将其存入内部寄存器中以待系统读取。一般在下一次采样之前，需要将CPLD复位来清除上一次采样的数据。由于外部时钟模式下的SSTRB始终为低，故本例没有对该信号进行处理。
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5 结束语
本文介绍了利用CPLD控制MAX1032进行采样的实现方法，包括CPLD的内部逻辑设计和对采样信号的处理等。实验证明，该方法能够适用需要使用CPLD控制外围电路的场合。
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