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如下左图、下右图所示,若A=0、B=0或A=B=0时,Y=0;只有A=B=l时,Y=l,下左图中,两光耦合器并联,只要A、B之一或全为0,就有至少一个光耦合器导通,Y=0;当A、B均为1时两光耦合器都截止,R3上拉使Y=l。下右图中,两光耦合器串联,只在A、B有0,就会使至少一个光耦合器截止,R3下拉使Y=0;当A、B均为l时,两光耦合器均导通,则Y=l。
本文关键字:耦合器 门电路 数字逻辑电路,单元电路 - 数字逻辑电路
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