引脚定义
正面，左方：
PIN
Non-Parity?
Parity
72 ECC
80 ECC
Description
1
VSS
VSS
VSS
VSS
Ground
2
DQ0
DQ0
DQ0
DQ0
Data 0
3
DQ1
DQ1
DQ1
DQ1
Data 1
4
DQ2
DQ2
DQ2
DQ2
Data 2
5
DQ3
DQ3
DQ3
DQ3
Data 3
6
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
7
DQ4
DQ4
DQ4
DQ4
Data 4
8
DQ5
DQ5
DQ5
DQ5
Data 5
9
DQ6
DQ6
DQ6
DQ6
Data 6
10
DQ7
DQ7
DQ7
DQ7
Data 7
11
DQ8
DQ8
DQ8
DQ8
Data 8
12
VSS
VSS
VSS
VSS
Ground
13
DQ9
DQ9
DQ9
DQ9
Data 9
14
DQ10
DQ10
DQ10
DQ10
Data 10
15
DQ11
DQ11
DQ11
DQ11
Data 11
16
DQ12
DQ12
DQ12
DQ12
Data 12
17
DQ13
DQ13
DQ13
DQ13
Data 13
18
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
19
DQ14
DQ14
DQ14
DQ14
Data 14
20
DQ15
DQ15
DQ15
DQ15
Data 15
21
n/c
CB0
CB0
CB0
Parity/Check Bit Input/Output 0
22
n/c
CB1
CB1
CB1
Parity/Check Bit Input/Output 1
23
VSS
VSS
VSS
VSS
Ground
24
n/c
n/c
n/c
CB8
Parity/Check Bit Input/Output 8
25
n/c
n/c
n/c
CB9
Parity/Check Bit Input/Output 9
26
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
27
/WE0
/WE0
/WE0
/WE0
Read/Write Input
28
/CAS0
/CAS0
/CAS0
/CAS0
Column Address Strobe 0
29
/CAS1
/CAS1
/CAS1
/CAS1
Column Address Strobe 1
30
/RAS0
/RAS0
/RAS0
/RAS0
Row Address Strobe 0
31
/OE0
/OE0
/OE0
/OE0
Output Enable
32
VSS
VSS
VSS
VSS
Ground
33
A0
A0
A0
A0
Address 0
34
A2
A2
A2
A2
Address 2
35
A4
A4
A4
A4
Address 4
36
A6
A6
A6
A6
Address 6
37
A8
A8
A8
A8
Address 8
38
A10
A10
A10
A10
Address 10
39
A12
A12
A12
A12
Address 12
40
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
41
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
42
DU
DU
DU
DU
Don't Use
正面，右方：
Pin
Non-Parity?
Parity?
72 ECC?
80 ECC?
Description
43
VSS
VSS
VSS
VSS
Ground
44
/OE2
/OE2
/OE2
/OE2
45
/RAS2
/RAS2
/RAS2
/RAS2
Row Address Strobe 2
46
/CAS2
/CAS2
/CAS2
/CAS2
Column Address Strobe 2
47
/CAS3
/CAS3
/CAS3
/CAS3
Column Address Strobe 3
48
/WE2
/WE2
/WE2
/WE2
Read/Write Input
49
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
50
n/c
n/c
n/c
CB10
Parity/Check Bit Input/Output 10
51
n/c
n/c
n/c
CB11
Parity/Check Bit Input/Output 11
52
n/c
CB2
CB2
CB2
Parity/Check Bit Input/Output 2
53
n/c
CB3
CB3
CB3
Parity/Check Bit Input/Output 3
54
VSS
VSS
VSS
VSS
Ground
55
DQ16
DQ16
DQ16
DQ16
Data 16
56
DQ17
DQ17
DQ17
DQ17
Data 17
57
DQ18
DQ18
DQ18
DQ18
Data 18
58
DQ19
DQ19
DQ19
DQ19
Data 19
59
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
60
DQ20
DQ20
DQ20
DQ20
Data 20
61
n/c
n/c
n/c
n/c
Not connected
62
DU
DU
DU
DU
Don't Use
63
n/c
n/c
n/c
n/c
Not connected
64
VSS
VSS
VSS
VSS
Ground
65
DQ21
DQ21
DQ21
DQ21
Data 21
66
DQ22
DQ22
DQ22
DQ22
Data 22
67
DQ23
DQ23
DQ23
DQ23
Data 23
68
VSS
VSS
VSS
VSS
Ground
69
DQ24
DQ24
DQ24
DQ24
Data 24
70
DQ25
DQ25
DQ25
DQ25
Data 25
71
DQ26
DQ26
DQ26
DQ26
Data 26
72
DQ27
DQ27
DQ27
DQ27
Data 27
73
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
74
DQ28
DQ28
DQ28
DQ28
Data 28
75
DQ29
DQ29
DQ29
DQ29
Data 29
76
DQ30
DQ30
DQ30
DQ30
Data 30
77
DQ31
DQ31
DQ31
DQ31
Data 31
78
VSS
VSS
VSS
VSS
Ground
79
n/c
n/c
n/c
n/c
Not connected
80
n/c
n/c
n/c
n/c
Not connected
81
n/c
n/c
n/c
n/c
Not connected
82
SDA
SDA
SDA
SDA
Serial Data
83
SCL
SCL
SCL
SCL
Serial CLOCk
84
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
反面，左方：
Pin
Non-Parity?
Parity?
72 ECC?
80 ECC?
Description
85
VSS
VSS
VSS
VSS
Ground
86
DQ32
DQ32
DQ32
DQ32
Data 32
87
DQ33
DQ33
DQ33
DQ33
Data 33
88
DQ34
DQ34
DQ34
DQ34
Data 34
89
DQ35
DQ35
DQ35
DQ35
Data 35
90
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
91
DQ36
DQ36
DQ36
DQ36
Data 36
92
DQ37
DQ37
DQ37
DQ37
Data 37
93
DQ38
DQ38
DQ38
DQ38
Data 38
94
DQ39
DQ39
DQ39
DQ39
Data 39
95
DQ40
DQ40
DQ40
DQ40
Data 40
96
VSS
VSS
VSS
VSS
Ground
97
DQ41
DQ41
DQ41
DQ41
Data 41
98
DQ42
DQ42
DQ42
DQ42
Data 42
99
DQ43
DQ43
DQ43
DQ43
Data 43
100
DQ44
DQ44
DQ44
DQ44
Data 44
101
DQ45
DQ45
DQ45
DQ45
Data 45
102
VCC
VCC
VCC
VCC
+5 VDC or +3.3 VDC
103
DQ46
DQ46
DQ46
DQ46
Data 46
104
DQ47
DQ47
DQ47
DQ47
Data 47
105
n/c
CB4
CB4
CB4
Parity/Check Bit Input/Output 4
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