系统以TI公司dsp为中心控制单元，ALTEra公司的FPGA为硬件逻辑平台，AD公司的 DDS 为频率合成器，采用2FSK调制解调方式，超前滞后支路的位同步方式，TOD跳频图案同步方式，以m序列作为跳频序列，辅助对偶跳频间隔控制手段，实现了高速、宽间隔跳频通信系统。系统达到40kbps的跳频速度，1 024个跳频频道，108M～189.84MHz的跳频带宽，400kHz的最小跳频间隔，小于0.5s的入网时间以及小于30s的同步最大时差。
本高速跳频通信系统与同类系统相比最大的优势体现在它40kbps的超高速跳频速率和近百兆的跳频带宽上。通过与国内外类似系统进行比较，40kbps的跳频速率处于技术领先位置。各关键模块性能优良，接口一致且工作稳定，可以灵活组合成多种数字通信系统的基带部分。相信本文对今后数字通信系统基带部分的研究和实现具有很强的借鉴意义。
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