4 系统测试结果
通过对系统的反复测试，来保证系统设计的可靠性。图8为上位机发送计算机字全为AAH时测到的波形，通道1是帧同步信号，通道2是数字量变换器发送来的计算机字请求信号，通道3是移位脉冲信号，通道4是系统发送的计算机字信号。
图9是系统接收计算机数码测的波形，通道1是帧同步信号，通道2是计算机字请求信号，通道3是码同步信号，通道4是计算机字数码信号。
因为指令信号是以并行方式发送的，所以不涉及到时序波形的问题。图10是指令信号都发送55H 时，接收指令数码测得的波形。图中通道1是帧同步信号，通道2是码同步信号，通道3是指令数码信号。可以看出信号的效果满足设计要求而且精度较高。
5 结束语
该测试系统充分利用FPGA强大的内部逻辑功能和与外围硬件电路的设计，来达到系统的测试功能。通过测试系统和数字量变换器的联试，验证了系统各项的输出，对数字量变换器的性能做出权衡性的检测。
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