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基于FPGA的导航抗干扰接收机数字变频实现

基于FPGA的导航抗干扰接收机数字变频实现

点击数:7362 次   录入时间:03-04 11:48:27   整理:http://www.55dianzi.com   DSP/FPGA技术
基于FPGA的导航抗干扰接收机数字变频的实现

    上变频后数据速率上升到90 MHz,以70 MHz的采样率进行采样,经过周期延拓后,中心频率在20 MHz上。将输入波形与频谱对比,数字上变频设计的结果符合设计期望。

    在资源使用上,芯片Spantan3s1600e可以满足资源需求。其资源占用率如表1所示。

基于FPGA的导航抗干扰接收机数字变频的实现

    可以看到,Slice的数据在50%~70%之间。此时,可以最大限度地发挥芯片的性能,也为以后的平台拓展留下空间。从上述数据可以看出,Xilinx芯片的资源利用率是可行的。

    2 结束语

    设计和实现了导航抗干扰接收系统中的上下变频模块。介绍了FPGA芯片的选择以及集成开发环境。并依据导航抗干扰接收系统的各种参数,对滤波器组仿真并建模,对DUC &DDC中每个模块的FPGA进行设计及功能仿真,通过对整个系统的集成验证,证明结果符合设计要求,基于FPGA的数字变频系统应用范围广泛、通用性高、修改参数方便、资源使用率较少,可用于通信、信号处理等相关领域移植。



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