为系统时钟框架中的粗同步信号指示时钟。基于这两个系统时钟信号，相关的计算单元计算产生差分调制系统的本地时钟，并进一步得到相关模块的控制时序。
本地存储单元为一个深度为384存储单元的单端口只读存储器，本地存储单元中存放着事先计算得到的编码相位参考符号，在控制时序的控制下，差分调制系统在每帧信号的帧头适时地从本地存储单元中读出相位参考符号，并将其放入反馈缓冲区中，为帧结构整合以及差分调制做准备。反馈缓冲区为一个移位寄存器，它将为输入的帧符号流提供差分调制的基准符号差分调制将由编码QPSK符号流的模8相加计算实现，为了增强系统的稳定性，使用加法模块与一个查找表实现模8相加计算。从图6中可以清楚地看到，经过差分调制的码流通过反馈回路引入复用模块，在严格的时序控制下参与后续码流的差分调制。
4 DAB信号调制系统的实际测试
利用Xilinx公司的System Generator软件将在Simulink平台中经过仿真验证的DAB信号调制系统硬件模型自动转换为可实现在FPGA芯片中的硬件工程。所选用的FPGA芯片为Xilinx公司的Virtex 6系列，型号为xc6vlx240t-1fff1156。
为了测试FPGA芯片内部所实现的DAB信号调制系统，从电脑端通过PCIe向FPGA芯片传送一个任意数据文件，作为激励整数源，这个数据文件的起始部分包含了十六进制数据串“DEAD BEEF”，用来开启FPGA芯片中的DAB信号调制系统。经过信号调制系统实时处理后的信号数据被传回电脑端，并记录在一个名为dabout．data的数据文件中，利用MATLAB软件打开并分析这个数据文件，验证其所记录的信号是否具有要求的时域帧结构及OFDM信号的频谱特性。测试平台的搭建如图7所示。
通过对dabout．data文件的分析，DAB信号调制系统所实时处理输出的信号具备完整的帧结构，并且其频谱特性良好，图8、图9为分析得到的时域及频域结果。
结语
本文利用基于模型没汁的思想，通过算法层和硬件层建模，利用Simulink平台和Xilinx公司提供的可编译硬件模型库，设计并在FPGA芯片中实现了Eureka 147数字音频广播基带信号处理链中的信号调制系统。实际测试表明，所没汁的系统能够实时处理输入数据流，并且所提供的输出信号满足DAB基带信号的时域帧结构和频域谱特征的要求。
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