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基于FPGA的可重构测速模块设计

基于FPGA的可重构测速模块设计

点击数:7994 次   录入时间:03-04 11:52:58   整理:http://www.55dianzi.com   DSP/FPGA技术

  4 结论

  利用FPGA的可重构特性,减少了外围器件、简化了CPU程序的设计。可以根据现场的要求灵活选用M法、T法、M/T法。对于变M/T法和直接测量频率法等测速电路同样可以采用这种嵌入式设计的方式。通过构造与CPU的接口,对于CPU而言,FPGA就如同一个外部RAM一样访问,不需要对测速过程进行任何干预。同时如果将测速时间和基准频率设计成外部可以控制的参数单元,就可以很方便地修改参数,实现不同场合、不同要求的情况下更高精度的控制。

  参考文献

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