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基于ADSP21160的高速并行信号处理板的设计

基于ADSP21160的高速并行信号处理板的设计

点击数:7235 次   录入时间:03-04 11:39:48   整理:http://www.55dianzi.com   DSP/FPGA技术

工作于高频波段(3~30MHz)的高频地波雷达是一种新体制雷达,具有优异的超视距探测能力,可应用于海态遥感以及对海面舰船目标和海上飞行目标进行探测与跟踪。雷达信号处理机是高频地波雷达的重要组成部分,由于在雷达信号处理过程中采用了大量复杂的信号处理算法,因此要求信号处理机具有每秒超过百亿次浮点运算的处理能力,如此高的处理速度在目前的技术条件下是无法用单片DSP实现的,需要采用并行处理技术才能解决处理速度上的需求。实现高频雷达信号处理机的高速处理能力,结构上要由多块信号处理板组成,而且多块处理板需并行工作,且每块处理板上要有多个并行工作的处理器。现有的商品化信号处理板通常与实际需求有较大差异,自行研制信号处理板,可以在信号处理算法和系统结构、处理器及存储器配置等实际需求方面得到匹配和优化,使系统的可靠性和可维护性得到提高,同时系统的成本也得以大幅度降低。

ADSP21160是AD公司的新一代SHARC数字信号处理器,它对ADSP2106x进行了扩充和提高,进一步提高了并行处理能力,且具有卓越的浮点运算能力。本文介绍的信号处理板是基于ADSP21160处理器设计,达到了系统性能要求。由于ADSP21160工作主频为100MHz,采用BGA封装,使得电路的设计难度加大,所以在硬件设计的过程中,需要运用高速电路设计方法进行设计。该电路板的设计利用了EDA软件,采用了合理的PCB层叠,并通过优化电路布局布线、采用端接技术抑制信号反射和减少串扰,进行信号完整性分析和仿真,确保了信号处理板稳定可靠地工作。

1 并行信号处理板设计

1.1 ADSP21160的性能特点

ADSP21160的工作主频为100MHz,指令周期为10ns,可进行32bit定点及32bit或40bit浮点运算,单片能提供高达600MFLOPS的运算能力;

具有单指令多数据流(SIMD)内部结构,有两个32bit的计算单元,每个单元包括算术逻辑单元(ALU)、移位器(Shifter)、乘累加器(MAC)、数据寄存器(Data Register),且保持与ADSP2106x代码高度兼容;

集成独立的I/O处理器,片内具有4Mbit双口SRAM,片外具有4G字的统一寻址空间;

PM、DM和I/O总线都达到了64bit,支持新的同步主机接口协议,链接口吞吐量增加到100MBps,可使处理器之间的数据吞吐量增加;

支持多至6片并行处理器互连,片内具有分布式总线仲裁逻辑,不需任何附加逻辑电路


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