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Verilog HDL语言基础之赋值语句和块语句

Verilog HDL语言基础之赋值语句和块语句

点击数:7160 次   录入时间:03-04 11:54:21   整理:http://www.55dianzi.com   电脑-单片机-自动控制
  语句n;

  end

  或者:

  begin:块名

  块内声明语句

  语句1;

  语句2;

  ......

  语句n;

  end

  其中:

  (1)块名即该块的名字,是一个标识符,其作用后面再详细介绍。

  (2)块内声明语句可以是参数声明语句,reg型变量声明语句,integer型变量声明语句或者real型变量声明语句。

  下面举例说明。

  例3:顺序块。

  begin

  areg = breg;

  creg = areg;  //creg的值为breg的值

  end

  从该例可以看出,第一条赋值语句先执行,areg的值更新为breg的值。然后程序流程控制转到第二条赋值语句,creg的值更新为areg的值。因为这两条赋值语句之间没有任何延迟时间,creg的值实为breg的值。当然可以在顺序块里延迟控制时间来分开两个赋值语句的执行时间,如例4所示。

  例4:加延时顺序块。

  begin

  areg = breg;

  #10 creg = areg;   //在两条赋值语句间延迟10个时间单位

  end



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  2.并行块

  并行块有以下4个特点。

  (1)块内语句是同时执行的,即程序流程控制一进入该并行块,块内语句则开始同时并行地执行。

  (2)块内每条语句的延迟时间是相对于程序流程控制进入到块内时的仿真时间的。

  (3)延迟时间是用来给赋值语句提供执行时序的。

  (4)当按时间时序排序在最后的语句执行完后或一个dISAble语句执行时,程序流程控制跳出该程序块。

  并行块的格式如下:

  fork

  语句1;

  语句2;

  .......

  语句n;

  join

  或者:

  fork:块名

  块内声明语句

  语句1;

  语句2;

  ......

  语句n;

  join

  其中:

  (1)块名即标识该块的一个名字,相当于一个标识符。

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