default:
LAMPB<=8;
endcase
end
else begin //倒计时
if(numb>1)
if(!numb［3:0］) begin
numb［3:0］<=9;
numb［7:4］<=numb［7:4］-1;
end
else
numb［3:0］<=numb［3:0］-1;
if(numb==2)
tempb<=0;
end
end
else begin
LAMPB<=4'b1000;
tempb<=0;
countb<=0;
end
end
endmodule
通过上面这个Verilog HDL模块，基本实现了交通灯控制器的基本功能。读者可将此设计应用于实际的硬件系统中，通过晶振、FPGA、开关、LED灯及数码管等资源即可完成硬件实现。
